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3상 전압원 인버터에서의 공통모드전압 저감을 위한 전압합성 장치

구분 특허/실용/디자인/상표
특허등록일자 2021-07-21
취득구분 등록
기술분류 화학
지식재산유형 국내출원
등록번호(특허) 10-2019-0153569
출원(등록)번호 10-2019-0153569
출원형태
발명자수 2
DOI 값
주요내용
특허 이미지

본 발명의 실시 형태는 전압 스위칭 상태에 따른 공간전압벡터의 영역으로서 A1,A2,A3,A4,A5,A6의 6개의 삼각형 영역으로 이루어진 영역을 전압 육각형이라 하고, 상전압 지령 벡터 산출 및 샘플링이 이루어지는 주기가 Ts라 하고, 전압 육각형 변 위에 위치하는 벡터로서 상전압 지령 벡터와 비교했을 때 오차의 크기가 같고 방향이 서로 반대인 두 벡터 중에서 상전압 지령 벡터보다 위상이 앞서는 벡터를 V lead 벡터라 하고 상전압 지령 벡터보다 위상이 늦는 벡터를 V lag 벡터라 할 때, V lead 벡터와 V lag 벡터를 산출하는 출력 벡터 산출부; Ts동안 상전압 지령 벡터가 합성되도록, 상기 V lead 벡터와 V lag 벡터 중 어느 하나를 Ts/2동안 상전압 지령 벡터를 대신하여 출력할 출력 벡터로서 결정하는 출력 벡터 및 캐리어 결정부; Ts/2동안 상전압 지령 벡터를 대신하여 출력할 V lead 벡터 또는 V lag 벡터의 스위칭 신호를 생성하여 인버터에 제공하는 스위칭 신호 생성부;를 포함할 수 있다.

발명자 정보

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